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ReNoC: A Network-on-Chip Architecture with Reconfigurable Topology., und . NOCS, Seite 55-64. IEEE Computer Society, (2008)Argo: A Real-Time Network-on-Chip Architecture With an Efficient GALS Implementation., , , , , und . IEEE Trans. VLSI Syst., 24 (2): 479-492 (2016)Behavioral Synthesis of Asynchronous Circuits Using Syntax Directed Translation as Backend., , und . IEEE Trans. VLSI Syst., 17 (2): 248-261 (2009)A resource-efficient network interface supporting low latency reconfiguration of virtual circuits in time-division multiplexing networks-on-chip., , , und . Journal of Systems Architecture - Embedded Systems Design, (2017)Router Designs for an Asynchronous Time-Division-Multiplexed Network-on-Chip., , , und . DSD, Seite 319-326. IEEE Computer Society, (2013)Demonstration of a Time-predictable Flight Controller on a Multicore Processor., , , , , , und . ISORC, Seite 95-96. IEEE, (2019)Synthesis of topology configurations and deadlock free routing algorithms for ReNoC-based systems-on-chip., , und . CODES+ISSS, Seite 481-490. ACM, (2009)A Time-Predictable Memory Network-on-Chip., , , und . WCET, Volume 39 von OASIcs, Seite 53-62. Schloss Dagstuhl - Leibniz-Zentrum für Informatik, (2014)A Time-predictable TTEthenet Node., , , und . ISORC, Seite 229-233. IEEE, (2019)A Channel Library for Asynchronous Circuit Design Supporting Mixed-Mode Modeling., , und . PATMOS, Volume 3254 von Lecture Notes in Computer Science, Seite 301-310. Springer, (2004)