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A Scheme for On-Chip Timing Characterization., , , und . VTS, Seite 24-29. IEEE Computer Society, (2006)Enhanced Leakage Reduction Techniques Using Intermediate Strength Power Gating., , , und . IEEE Trans. VLSI Syst., 15 (11): 1215-1224 (2007)Characterization and design for variability and reliability., , und . CICC, Seite 341-346. IEEE, (2008)A fast hybrid carry-lookahead/carry-select adder design., , und . ACM Great Lakes Symposium on VLSI, Seite 149-152. ACM, (2001)A Low-Overhead Virtual Rail Technique for SRAM Leakage Power Reduction., , , , und . ICCD, Seite 574-584. IEEE Computer Society, (2005)On-Chip Delay Measurement Based Response Analysis for Timing Characterization., , , , , und . J. Electronic Testing, 26 (6): 599-619 (2010)An on-chip dual supply charge pump system for 45nm PD SOI eDRAM., , , , , , , , , und 3 andere Autor(en). ESSCIRC, Seite 66-69. IEEE, (2008)Designing for a gigahertz [guTS integer processor]., , , , , , , und . IEEE Micro, 18 (3): 66-74 (1998)Dynamically Pulsed MTCMOS with Bus Encoding for Total Power and Crosstalk Minimization., , , , und . ISQED, Seite 88-93. IEEE Computer Society, (2005)Power Gating with Multiple Sleep Modes., , , und . ISQED, Seite 633-637. IEEE Computer Society, (2006)