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The design and application of the PowerPC 405LP energy-efficient system-on-a-chip., , und . IBM Journal of Research and Development, 47 (5-6): 631-640 (2003)A Distributed Critical-Path Timing Monitor for a 65nm High-Performance Microprocessor., , , , , , , , und . ISSCC, Seite 398-399. IEEE, (2007)Experience with building a commodity Intel-based ccNUMA system., , , , , , , , , und 5 andere Autor(en). IBM Journal of Research and Development, 45 (2): 207-228 (2001)A Scheme for On-Chip Timing Characterization., , , und . VTS, Seite 24-29. IEEE Computer Society, (2006)Dynamically Optimized Synchronous Communication for Low Power System on Chip Designs., , und . ICCD, Seite 134-139. IEEE Computer Society, (2003)Single-cycle, pulse-shaped critical path monitor in the POWER7+ microprocessor., , , , , , , , und . ISLPED, Seite 193-198. IEEE, (2013)On-Chip Delay Measurement Based Response Analysis for Timing Characterization., , , , , und . J. Electronic Testing, 26 (6): 599-619 (2010)An on-chip dual supply charge pump system for 45nm PD SOI eDRAM., , , , , , , , , und 3 andere Autor(en). ESSCIRC, Seite 66-69. IEEE, (2008)