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Disambiguierung von "Hunter, Hillery C."

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A 500 MHz Random Cycle, 1.5 ns Latency, SOI Embedded DRAM Macro Featuring a Three-Transistor Micro Sense Amplifier.

, , , , , , , , , , , , , , , , und . IEEE J. Solid State Circuits, 43 (1): 86-95 (2008)

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C. Traut

C. Honold

Dr. Torbjörn Cunis University of Stuttgart

Probabilistic Safety Analysis for Model Predictive Control with a Case Study on Aircraft Upset Recovery. Nonlinear and Constrained Control: Applications, Synergies, Challenges and Opportunities, Springer Nature Switzerland, Cham, (2025)

Univ. -Prof. Dr. -Ing. André Casal Kulzer University of Stuttgart

Data-Driven Modeling Approach for the Virtual Conversion of a Hybridized Passenger Car, , , und . 2023 IEEE Conference on Artificial Intelligence (CAI), Seite 32-35. IEEE, (2023)
Data-Driven Modeling Approach for the Virtual Conversion of a Hybridized Passenger Car, , , und . 2023 IEEE Conference on Artificial Intelligence (CAI), Seite 32-35. IEEE, (2023)Water Injection in Spark-Ignition Engine II (FVV Project Nr. 1367), , , und . 23. Internationales Stuttgarter Symposium : Automobil- und Motorentechnik, Springer Vieweg, (2023)Numerical Investigation on the Mechanism of Tumble Caused Cycle-to-Cycle Variation of High-Tumble Spark-Ignition Engine, , , , , und . 23. Internationales Stuttgarter Symposium : Automobil- und Motorentechnik, Springer Vieweg, (2023)

Gerasimos Chourdakis University of Stuttgart

System Regression Tests for the preCICE Coupling Ecosystem, , und . deRSE24 - Selected Contributions of the 4th Conference for Research Software Engineering in Germany, (2025)
 

Weitere Publikationen von Autoren mit dem selben Namen

Hardware Support for Dynamic Management of Compiler-Directed Computation Reuse., , , und . ASPLOS, Seite 222-233. ACM Press, (2000)The virtual write queue: coordinating DRAM and last-level cache policies., , , , und . ISCA, Seite 72-82. ACM, (2010)A 1 MB Cache Subsystem Prototype With 1.8 ns Embedded DRAMs in 45 nm SOI CMOS., , , , , , , , , und 11 andere Autor(en). IEEE J. Solid State Circuits, 44 (4): 1216-1226 (2009)BlueConnect: Decomposing all-reduce for deep learning on heterogeneous network hierarchy., , , , und . IBM Journal of Research and Development, 63 (6): 1:1-1:11 (2019)PANEL: Open panel and discussion on tackling complexity, reproducibility and tech transfer challenges in a rapidly evolving AI/ML/systems research., , , , , und . ReQuEST@ASPLOS, Seite 7. ACM, (2018)Guest Editorial Computing in Emerging Technologies (Second Issue)., , , und . IEEE J. Emerg. Sel. Topics Circuits Syst., 5 (1): 1-4 (2015)An innovative low-power high-performance programmable signal processor for digital communications., , , , , , , , , und 6 andere Autor(en). IBM Journal of Research and Development, 47 (2-3): 299-326 (2003)Hardware-compiler co-design for adjustable data power savings., , , und . Microprocessors and Microsystems - Embedded Hardware Design, 33 (4): 244-253 (2009)Code coverage and input variability: effects on architecture and compiler research., und . CASES, Seite 79-87. ACM, (2002)Enhancing loop buffering of media and telecommunications applications using low-overhead predication., , und . MICRO, Seite 262-273. ACM/IEEE Computer Society, (2001)