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Code generation from a domain-specific language for C-based HLS of hardware accelerators., , , , und . CODES+ISSS, Seite 17:1-17:10. ACM, (2014)An image processing library for C-based high-level synthesis., , , und . FPL, Seite 1-4. IEEE, (2014)Netlist-level IP protection by watermarking for LUT-based FPGAs., , und . FPT, Seite 209-216. IEEE, (2008)A deeply pipelined and parallel architecture for denoising medical images., , , und . FPT, Seite 485-490. IEEE, (2010)System integration of tightly-coupled processor arrays using reconfigurable buffer structures., , , , und . Conf. Computing Frontiers, Seite 2:1-2:4. ACM, (2013)Modeling and synthesis of communication subsystems for loop accelerator pipelines., , , und . ASAP, Seite 125-132. IEEE Computer Society, (2010)Big Data and HPC Acceleration with Vivado HLS., , , , , , und . FPGAs for Software Programmers, Springer, (2016)HIPAcc., , , und . FPGAs for Software Programmers, Springer, (2016)Real-timerange image preprocessing on FPGAs., , , und . ReConFig, Seite 1-8. IEEE, (2013)Power Management Strategies for Serial RapidIO Endpoints in FPGAs., , und . FCCM, Seite 101-108. IEEE Computer Society, (2012)