Autor der Publikation

Bitte wählen Sie eine Person um die Publikation zuzuordnen

Um zwischen Personen mit demselben Namen zu unterscheiden, wird der akademische Grad und der Titel einer wichtigen Publikation angezeigt. Zudem lassen sich über den Button neben dem Namen einige der Person bereits zugeordnete Publikationen anzeigen.

 

Weitere Publikationen von Autoren mit dem selben Namen

Efficient Evaluation of Power/Area/Latency Design Trade-Offs for Coarse-Grained Reconfigurable Processor Arrays., , und . J. Low Power Electronics, 7 (1): 29-40 (2011)Introduction to the Special Issue on Testing, prototyping, and debugging of multi-core architectures., und . Journal of Systems Architecture - Embedded Systems Design, 61 (10): 600 (2015)A holistic approach for tightly coupled reconfigurable parallel processors., , , , , und . Microprocessors and Microsystems - Embedded Hardware Design, 33 (1): 53-62 (2009)A Dynamically Reconfigurable Weakly Programmable Processor Array Architecture Template., , , und . ReCoSoC, Seite 31-37. Univ. Montpellier II, (2006)An Architecture Description Language for Massively Parallel Processor Architectures., , , , , und . MBMV, Seite 11-20. Fraunhofer Institut für Integrierte Schaltungen, (2006)Symbolic inner loop parallelisation for massively parallel processor arrays., , , und . MEMOCODE, Seite 219-228. IEEE, (2014)Acceleration of Multiresolution Imaging Algorithms: A Comparative Study., , , , und . ASAP, Seite 211-214. IEEE Computer Society, (2009)A Design Methodology for Hardware Acceleration of Adaptive Filter Algorithms in Image Processing., , , , und . ASAP, Seite 331-340. IEEE Computer Society, (2006)Domain-specific augmentations for High-Level Synthesis., , , , , und . ASAP, Seite 173-177. IEEE Computer Society, (2014)Generating Device-specific GPU Code for Local Operators in Medical Imaging., , , , und . IPDPS, Seite 569-581. IEEE Computer Society, (2012)