Autor der Publikation

Clock Tree Resynthesis for Multi-Corner Multi-Mode Timing Closure.

, , , und . IEEE Trans. on CAD of Integrated Circuits and Systems, 34 (4): 589-602 (2015)

Bitte wählen Sie eine Person um die Publikation zuzuordnen

Um zwischen Personen mit demselben Namen zu unterscheiden, wird der akademische Grad und der Titel einer wichtigen Publikation angezeigt. Zudem lassen sich über den Button neben dem Namen einige der Person bereits zugeordnete Publikationen anzeigen.

 

Weitere Publikationen von Autoren mit dem selben Namen

Large Scale VLSI Circuit Simulation Using Point Relaxation., , , und . CSC, Seite 343-347. CSREA Press, (2010)Towards Optimal Performance-Area Trade-Off in Adders by Synthesis of Parallel Prefix Structures., , , und . IEEE Trans. on CAD of Integrated Circuits and Systems, 33 (10): 1517-1530 (2014)Polynomial Time Algorithm for Area and Power Efficient Adder Synthesis in High-Performance Designs., , , und . IEEE Trans. on CAD of Integrated Circuits and Systems, 35 (5): 820-831 (2016)OSFA: a new paradigm of gate-sizing for power/performance optimizations under multiple operating conditions., , , und . DAC, Seite 129:1-129:6. ACM, (2015)Catalytic mechanism of salicylate dioxygenase : QM/MM simulations reveal the origin of unexpected regioselectivity of the ring cleavage, und . Chemistry - a European journal, 23 (37): 8949-8962 (2017)Clock Tree Resynthesis for Multi-Corner Multi-Mode Timing Closure., , , und . IEEE Trans. on CAD of Integrated Circuits and Systems, 34 (4): 589-602 (2015)Reliability Aware Gate Sizing Combating NBTI and Oxide Breakdown., und . VLSI Design, Seite 38-43. IEEE Computer Society, (2014)CSL: Coordinated and scalable logic synthesis techniques for effective NBTI reduction., , , , und . ICCD, Seite 236-243. IEEE Computer Society, (2015)Towards optimal performance-area trade-off in adders by synthesis of parallel prefix structures., , , und . DAC, Seite 48:1-48:8. ACM, (2013)Cross-Layer Optimization for High Speed Adders: A Pareto Driven Machine Learning Approach., , , , und . IEEE Trans. on CAD of Integrated Circuits and Systems, 38 (12): 2298-2311 (2019)