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    3A 2.5 mW 80 dB DR 36 dB SNDR 22 MS/s Logarithmic Pipeline ADC
     

    J. Lee, J. Kang, S. Park, J. Seo, J. Anders, J. Guilherme, und M. Flynn. IEEE Journal of Solid-State Circuits, 44 (10): 2755-2765 (Oktober 2009)
    vor 5 Jahren von @jens.anders
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      4A 2.5mW 80dB DR 36dB SNDR 22MS/s Logarithmic Pipeline ADC
       

      J. Lee, S. Park, J. Kang, J. Seo, J. Anders, und M. Flynn. 2007 IEEE Symposium on VLSI Circuits, Seite 194-195. (Juni 2007)
      vor 5 Jahren von @jens.anders
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        ADCPipeline
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