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A 2 Gb/s balanced AES crypto-chip implementation.

F. Gürkaynak, A. Burg, N. Felber, W. Fichtner, D. Gasser, F. Hug, und H. Kaeslin. ACM Great Lakes Symposium on VLSI, Seite 39-44. ACM, (2004)

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Hon. -Prof. Dr. -Ing. Hubert Ehbing University of Stuttgart

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