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Improving high level synthesis optimization opportunity through polyhedral transformations., , , , , und . FPGA, Seite 9-18. ACM, (2013)System-level design solutions: Enabling the IoT explosion., , , , , , und . ASICON, Seite 1-4. IEEE, (2015)Debugging and verifying SoC designs through effective cross-layer hardware-software co-simulation., , , , , und . DAC, Seite 7:1-7:6. ACM, (2016)Behavioral-level IP integration in high-level synthesis., , , und . FPT, Seite 172-175. IEEE, (2015)An Accurate GPU Performance Model for Effective Control Flow Divergence Optimization., , , und . IPDPS, Seite 83-94. IEEE Computer Society, (2012)High-level synthesis with behavioral level multi-cycle path analysis., , , , und . FPL, Seite 1-8. IEEE, (2013)A study of high-level synthesis: Promises and challenges., , , und . ASICON, Seite 1102-1105. IEEE, (2011)Real-time implementation and performance optimization of 3D sound localization on GPUs., , , , , , und . DATE, Seite 832-835. IEEE, (2012)High-level synthesis of multiple dependent CUDA kernels on FPGA., , , , und . ASP-DAC, Seite 305-312. IEEE, (2013)Register and thread structure optimization for GPUs., , , und . ASP-DAC, Seite 461-466. IEEE, (2013)