Autor der Publikation

Bitte wählen Sie eine Person um die Publikation zuzuordnen

Um zwischen Personen mit demselben Namen zu unterscheiden, wird der akademische Grad und der Titel einer wichtigen Publikation angezeigt. Zudem lassen sich über den Button neben dem Namen einige der Person bereits zugeordnete Publikationen anzeigen.

 

Weitere Publikationen von Autoren mit dem selben Namen

A design methodology for fully reconfigurable Delta-Sigma data converters., , und . DATE, Seite 1379-1384. IEEE, (2009)A 2.6 mW 6 bit 2.2 GS/s Fully Dynamic Pipeline ADC in 40 nm Digital CMOS., , , , und . J. Solid-State Circuits, 45 (10): 2080-2090 (2010)A 86 MHz-12 GHz Digital-Intensive PLL for Software-Defined Radios, Using a 6 fJ/Step TDC in 40 nm Digital CMOS., , , , , und . J. Solid-State Circuits, 45 (10): 2116-2129 (2010)A 2.2 mW 1.75 GS/s 5 Bit Folding Flash ADC in 90 nm Digital CMOS., , , , und . J. Solid-State Circuits, 44 (3): 874-882 (2009)A 2-mm2 0.1-5 GHz Software-Defined Radio Receiver in 45-nm Digital CMOS., , , , , , , , , und 1 andere Autor(en). J. Solid-State Circuits, 44 (12): 3486-3498 (2009)Flexible Baseband Analog Circuits for Software-Defined Radio Front-Ends., , , und . J. Solid-State Circuits, 42 (7): 1501-1512 (2007)An Incremental-Charge-Based Digital Transmitter With Built-in Filtering., , , und . J. Solid-State Circuits, 50 (12): 3065-3076 (2015)A 2.4 GHz Low-Power Sixth-Order RF Bandpass ΔΣ Converter in CMOS., , , , , , und . J. Solid-State Circuits, 44 (11): 2873-2880 (2009)New Associate Editors.. J. Solid-State Circuits, 54 (6): 1515-1516 (2019)A 150 kHz-80 MHz BW Discrete-Time Analog Baseband for Software-Defined-Radio Receivers using a 5th-Order IIR LPF, Active FIR and a 10 bit 300 MS/s ADC in 28 nm CMOS., , , , und . J. Solid-State Circuits, 51 (7): 1593-1606 (2016)