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Methodology for Fast Pattern Matching by Deterministic Finite Automaton with Perfect Hashing., , und . DSD, Seite 823-829. IEEE Computer Society, (2009)Mapping Trained Neural Networks to FPNNs., , und . DDECS, Seite 157-160. IEEE Computer Society, (2015)Fault tolerant system design and SEU injection based testing., , , und . Microprocessors and Microsystems - Embedded Hardware Design, 37 (2): 155-173 (2013)Fault Tolerant Structure for SRAM-Based FPGA via Partial Dynamic Reconfiguration., , und . DSD, Seite 365-372. IEEE Computer Society, (2010)High speed pattern matching algorithm based on deterministic finite automata with faulty transition table., und . ANCS, Seite 7. ACM, (2010)Netbench: Framework for Evaluation of Packet Processing Algorithms., , , , und . ANCS, Seite 95-96. IEEE Computer Society, (2011)Hardware architecture for the fast pattern matching., , und . DDECS, Seite 120-123. IEEE Computer Society, (2013)Hardware accelerated pattern matching based on Deterministic Finite Automata with perfect hashing., und . DDECS, Seite 149-152. IEEE Computer Society, (2010)Automatic Construction of On-line Checking Circuits Based on Finite Automata., , und . DSD, Seite 326-332. IEEE Computer Society, (2014)Dependability Analysis of Fault Tolerant Systems Based on Partial Dynamic Reconfiguration Implemented into FPGA., , , und . DSD, Seite 250-257. IEEE Computer Society, (2012)