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A Parallel Architecture for Optical Computing., und . PPSC, Seite 414-418. SIAM, (1987)Adaptive inter-router links for low-power, area-efficient and reliable Network-on-Chip (NoC) architectures., , , und . ASP-DAC, Seite 1-6. IEEE, (2009)A new compiler-directed cache coherence scheme for shared memory multiprocessors with fast and parallel explicit invalidation., und . ISCA, Seite 428. ACM, (1992)LEAD: learning-enabled energy-aware dynamic voltage/frequency scaling in NoCs., , , und . DAC, Seite 82:1-82:6. ACM, (2018)Design of adaptive communication channel buffers for low-power area-efficient network-on-chip architecture., , und . ANCS, Seite 47-56. ACM, (2007)Dynamic error mitigation in NoCs using intelligent prediction techniques., , , und . MICRO, Seite 1-12. IEEE Computer Society, (2016)Co-design of channel buffers and crossbar organizations in NoCs architectures., , , , und . ICCAD, Seite 219-226. IEEE Computer Society, (2011)A Compiler Directed Cache Coherence Scheme with Fast and Parallel Explicit Invalidation., und . ICPP (1), Seite 2-9. CRC Press, (1992)OWN: Optical and Wireless Network-on-Chip for Kilo-core Architectures., , , , und . Hot Interconnects, Seite 44-51. IEEE Computer Society, (2015)An Energy-Efficient Network-on-Chip Design using Reinforcement Learning., und . DAC, Seite 47. ACM, (2019)