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Weitere Publikationen von Autoren mit dem selben Namen

Automatic module allocation in high level synthesis., , , und . EURO-DAC, Seite 328-333. IEEE Computer Society Press, (1992)Automatic generation of interprocess communication in the PARAGON system., , und . RSP, Seite 24-29. IEEE Computer Society, (1996)Timing preserving interface transformations for the synthesis of behavioral VHDL., und . EURO-DAC, Seite 618-623. IEEE Computer Society, (1994)CASCH - ein Scheduling-Algorithmus für "High-Level"-Synthese., , und . Rechnergestützter Entwurf und Architektur mikroelektronischer Systeme, Volume 255 von Informatik-Fachberichte, Seite 143-156. Springer, (1990)Fast Bit-Accurate C++ Datatypes For Functional System Verification and Synthesis., , und . FDL, Seite 337-345. ECSI, (2004)CASCH: a scheduling algorithm for "high level"-synthesis., , und . EURO-DAC, Seite 311-315. EEE Computer Society, (1991)Interface specification and synthesis for VHDL processes., und . EURO-DAC, Seite 152-157. IEEE Computer Society, (1993)Spezifikation und Synthese aus taktfreien VHDL Verhaltensbeschreibungen.. Eberhard Karls University of Tübingen, (1997)Specification of interface components for synchronous data paths., und . HLSS, Seite 134-139. ACM, (1994)