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Exploring Performance Tradeoffs for Clustered VLIW ASIPs., , und . ICCAD, Seite 504-510. IEEE Computer Society, (2000)Algorithm and architecture-level design space exploration using hierarchical data flows., und . ASAP, Seite 272-282. IEEE Computer Society, (1997)Self-Imposed Temporal Redundancy: An Efficient Technique to Enhance the Reliability of Pipelined Functional Units., , und . SBAC-PAD, Seite 45-53. IEEE Computer Society, (2007)RS-FDRA: a register sensitive software pipelining algorithm for embedded VLIW processors., und . CODES, Seite 67-72. ACM, (2001)Compiler Controlled Speculation for Power Aware ILP Extraction in Dataflow Architectures., , und . HiPEAC, Volume 5409 von Lecture Notes in Computer Science, Seite 324-338. Springer, (2009)Compiler-Directed ILP Extraction for Clustered VLIW/EPIC Machines., und . Embedded Software for SoC, Kluwer / Springer, (2003)Embedded Architect: A Tool for Early Performance Evaluation of Embedded Software., und . ICSE, Seite 824-825. IEEE Computer Society, (2003)Global Optimization of Compositional Systems., , , , und . FMCAD, Seite 93-100. IEEE Computer Society, (2007)NREC: Risk Assessment and Planning of Complex Designs., und . IEEE Design & Test of Computers, 14 (1): 42-49 (1997)A Survey of Digital Design Reuse., und . IEEE Design & Test of Computers, 18 (3): 98-107 (2001)