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TriZone: A Design of MLC STT-RAM Cache for Combined Performance, Energy, and Reliability Optimizations.

Z. Liu, M. Mao, T. Liu, X. Wang, W. Wen, Y. Chen, H. Li, D. Wang, Y. Pei, und N. Ge. IEEE Trans. on CAD of Integrated Circuits and Systems, 37 (10): 1985-1998 (2018)

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Dexing Liu University of Stuttgart

Jan Liu University of Stuttgart

M.Sc. Zhuoran Liu University of Stuttgart

Yanchao Liu University of Stuttgart

Shuang Liu University of Stuttgart

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